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仿真-YD

SiP設(shè)計能力

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SiP設(shè)計優(yōu)勢

- 芯片-封裝-系統(tǒng)協(xié)同規(guī)劃與設(shè)計

- 仿真與設(shè)計同步進(jìn)行

- Wire Bond 3D建模

- 仿真精度高,優(yōu)化準(zhǔn)確

- 熟悉主流的封裝基板生產(chǎn)工藝

- Hspice模型轉(zhuǎn)IBIS模型

- 可協(xié)助生成設(shè)計指導(dǎo)書

SiP設(shè)計優(yōu)勢

SiP設(shè)計案例展示

- 9個DDR4顆粒,4+5層堆疊

- DDR4運行速率3200Mbps

- 整體性能媲美SO-DIMM



SiP設(shè)計案例展示

ATE能力介紹

- 待測試芯片pin數(shù)多,多達(dá)幾千pin

- 疊層多達(dá)40層以上, 板厚超過5mm

- 走線和過孔的設(shè)計和加工趨于極限能力

- 需要進(jìn)行精確仿真來保證走線不會影響芯片測試精度

ATE能力介紹
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